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Design of an interface ASIC for RISC systems using a VHDL based "independent" environment

Desde 1995-10-01 hasta 1997-06-30 | MLS Sitio web

Detalles del proyecto

Coste total:

EUR 150 000

Aportación de la UE:

EUR 150 000

Coordinado en:

Greece

Régimen de financiación:

EST - Marie Curie actions-Early-stage Training

Objetivo

Coordinador

Mls Firmware
Greece
Alex. Papanastasiou St. 34
54639 Thessaloniki
Greece
Contacto administrativo: Nikolaos ZISSIS
Tel.: +30-2310-845845
Fax: +30-2310-868912
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