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CORDIS - Forschungsergebnisse der EU
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Inhalt archiviert am 2024-04-19

Real-Time DSP Emulation System

Ziel

The objective of RETIDES is to provide a platform for the fast prototyping of digital signal processing (DSP) systems. To this end, techniques, hardware and software will be provided to compile DSP algorithms, described in a high-level language, onto programmable parallel hardware for real-time execution.
A platform has been developed for the fast prototyping of digital signal processing (DSP) systems. To this end, techniques, hardware and software have been provided to compile DSP algorithms, described in a high level language, onto programmable parallel hardware for real time execution.

The DSP emulation platform resulting from this work is a turn key integrated hardware and software computer aided design (CAD) tool. It plays a crucial role in the design flow of integrated DSP systems, leading to:
the ability to verify DSP systems in their real time environment before committing them to silicon integration, so lessening design risks;
a large reduction in simulation time and prototyping effort, resulting in shorter development cycles;
the ability to develop hardware and software in parallel;
the ability to prototype in the early phases of a design project (behavioural emulation) as well as in the end phase (hardware emulation);
the provision of a significant acceleration in simulations when used in a simulation mode (with tracing of signals, etc).

A full specification of the DSP real time emulation system has been achieved. A first product resulting from the project has hit the market. In June 1993, Integrated Circuit Applications (INCA) released their new 'Virtual ASIC II' logic emulation system with introduction at the Design Automation Conference, DAC '93.
The DSP emulation platform resulting from this work will be a turn-key integrated hardware and software CAD tool. It will play a crucial role in the design flow of integrated DSP systems, leading to:

- the ability to verify DSP systems in their real-time environment before committing them to silicon integration, so lessening design risks
- a large reduction in simulation time and prototyping effort, resulting in shorter development cycles
- the ability to develop hardware and software in parallel
- the ability to prototype in the early phases of a design project (behavioural emulation) as well as in the end phase (hardware emulation)
- the provision of a significant acceleration in simulations when used in a simulation mode (with tracing of signals, etc).

RETIDES exploits results from project 97 and from SPRITE (project 2260), which resulted in the CATHEDRAL and PIRAMID silicon compilers for DSP ASICs, currently undergoing commercialisation as MISTRAL compilers in the DSP Station developed at EDC/Mentor.

Wissenschaftliches Gebiet (EuroSciVoc)

CORDIS klassifiziert Projekte mit EuroSciVoc, einer mehrsprachigen Taxonomie der Wissenschaftsbereiche, durch einen halbautomatischen Prozess, der auf Verfahren der Verarbeitung natürlicher Sprache beruht. Siehe: Das European Science Vocabulary.

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Programm/Programme

Mehrjährige Finanzierungsprogramme, in denen die Prioritäten der EU für Forschung und Innovation festgelegt sind.

Thema/Themen

Aufforderungen zur Einreichung von Vorschlägen sind nach Themen gegliedert. Ein Thema definiert einen bestimmten Bereich oder ein Gebiet, zu dem Vorschläge eingereicht werden können. Die Beschreibung eines Themas umfasst seinen spezifischen Umfang und die erwarteten Auswirkungen des finanzierten Projekts.

Daten nicht verfügbar

Aufforderung zur Vorschlagseinreichung

Verfahren zur Aufforderung zur Einreichung von Projektvorschlägen mit dem Ziel, eine EU-Finanzierung zu erhalten.

Daten nicht verfügbar

Finanzierungsplan

Finanzierungsregelung (oder „Art der Maßnahme“) innerhalb eines Programms mit gemeinsamen Merkmalen. Sieht folgendes vor: den Umfang der finanzierten Maßnahmen, den Erstattungssatz, spezifische Bewertungskriterien für die Finanzierung und die Verwendung vereinfachter Kostenformen wie Pauschalbeträge.

Daten nicht verfügbar

Koordinator

PHILIPS INTERNATIONAL TECHNOLOGY CENTRE LEUVEN
EU-Beitrag
Keine Daten
Adresse
PLEINSTRAAT, 135
3001 LEUVEN
Belgien

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Gesamtkosten

Die Gesamtkosten, die dieser Organisation durch die Beteiligung am Projekt entstanden sind, einschließlich der direkten und indirekten Kosten. Dieser Betrag ist Teil des Gesamtbudgets des Projekts.

Keine Daten

Beteiligte (4)

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