RISC-V GENERATION OF HIGH PERFORMANCE AUTOMOTIVE PROCESSORS AND COMPUTING PLATFORMS

Projektinformationen

Rigoletto

ID Finanzhilfevereinbarung: 101194371

DOI

10.3030/101194371

EK-Unterschriftsdatum 19 Mai 2025

Startdatum 1 Juli 2025

Enddatum 30 Juni 2028

Finanziert unter

• Digital, Industry and Space

Gesamtkosten

€ 65 160 523,27

EU-Beitrag

€ 18 738 887,95

Koordiniert durch

INFINEON TECHNOLOGIES AG
Germany

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Veröffentlichungen

Conference proceedings (4)

SlimFlit: A simple Network-on-Chip for Real-Time Systems

Autoren: Tjark Petersen, Voica Gavrilut, Luca Pezzarossa, Martin Schoeberl
Veröffentlicht in: 2026 29th International Symposium on Real-Time Distributed Computing (ISORC), 2026
Herausgeber: IEEE
DOI: 10.1109/ISORC70347.2026.11605558

GenAI-Driven Approach to RISC-V Supply Chain Exploration

Autoren: Nenad Petrovic, Andre Schamschurko, Yingjie Xu, Alois Knoll
Veröffentlicht in: IntelliSys, Ausgabe 2026, 2026
Herausgeber: The Science and Information (SAI) Organization

Evaluating the Impact of a Vector Co-Processor on a Memory System through Hybrid Simulation

Autoren: J Parker Jones, Daniel Mueller-Gritschneder
Veröffentlicht in: Proceedings of the 23rd ACM International Conference on Computing Frontiers: Workshops and Special Sessions, 2026
Herausgeber: ACM
DOI: 10.1145/3801488.3806235

Automated Deployment of Real-Time Tasks for Phased Execution on Scratchpad-Based Multicore Platforms

Autoren: Konstantin Dudzik, Maximilian Kirschner, Jürgen Becker
Veröffentlicht in: 2025 IEEE 18th International Symposium on Embedded Multicore/Many-core Systems-on-Chip (MCSoC), 2025
Herausgeber: IEEE
DOI: 10.1109/MCSOC67473.2025.00092