EDA tools for Secure and Reliable High Level Synthesis Implementations

Información del proyecto

SecuReHLS

Identificador del acuerdo de subvención: 895937

DOI

10.3030/895937

Proyecto cerrado

Fecha de la firma de la CE 7 Abril 2020

Fecha de inicio 1 Septiembre 2020

Fecha de finalización 14 Febrero 2024

Financiado con arreglo a

• EXCELLENT SCIENCE - Marie Skłodowska-Curie Actions

Coste total

€ 165 085,44

Aportación de la UE

€ 165 085,44

Coordinado por

UNIVERSITY OF PIRAEUS RESEARCH CENTER
Greece

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Publicaciones

Conference proceedings (3)

On the Prediction of Hardware Security Properties of HLS Designs Using Graph Neural Networks.

Autores: Koufopoulou, Amalia-Artemis, Athanasios Papadimitriou, Aggelos Pikrakis, Mihalis Psarakis, and David Hely
Publicado en: 2023
Editor: IEEE International Symposium on Defect and Fault Tolerance in VLSI and Nanotechnology Systems (DFT)
DOI: 10.1109/dft59622.2023.10313544

Analyzing the single event upset vulnerability of binarized neural networks on SRAM FPGAs.

Autores: Souvatzoglou, Ioanna, Athanasios Papadimitriou, Aitzan Sari, Vasileios Vlagkoulis, and Mihalis Psarakis
Publicado en: 2021
Editor: IEEE International Symposium on Defect and Fault Tolerance in VLSI and Nanotechnology Systems (DFT)
DOI: 10.1109/dft52944.2021.9568280

Security and Reliability Evaluation of Countermeasures implemented using High-Level Synthesis.

Autores: Koufopoulou, Amalia-Artemis, Kalliopi Xevgeni, Athanasios Papadimitriou, Mihalis Psarakis, and David Hely
Publicado en: 2022
Editor: IEEE 28th International Symposium on On-Line Testing and Robust System Design (IOLTS)
DOI: 10.1109/iolts56730.2022.9897824