EDA tools for Secure and Reliable High Level Synthesis Implementations

Projektinformationen

SecuReHLS

ID Finanzhilfevereinbarung: 895937

DOI

10.3030/895937

Projekt abgeschlossen

EK-Unterschriftsdatum 7 April 2020

Startdatum 1 September 2020

Enddatum 14 Februar 2024

Finanziert unter

• EXCELLENT SCIENCE - Marie Skłodowska-Curie Actions

Gesamtkosten

€ 165 085,44

EU-Beitrag

€ 165 085,44

Koordiniert durch

UNIVERSITY OF PIRAEUS RESEARCH CENTER
Greece

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Veröffentlichungen

Conference proceedings (3)

On the Prediction of Hardware Security Properties of HLS Designs Using Graph Neural Networks.

Autoren: Koufopoulou, Amalia-Artemis, Athanasios Papadimitriou, Aggelos Pikrakis, Mihalis Psarakis, and David Hely
Veröffentlicht in: 2023
Herausgeber: IEEE International Symposium on Defect and Fault Tolerance in VLSI and Nanotechnology Systems (DFT)
DOI: 10.1109/dft59622.2023.10313544

Analyzing the single event upset vulnerability of binarized neural networks on SRAM FPGAs.

Autoren: Souvatzoglou, Ioanna, Athanasios Papadimitriou, Aitzan Sari, Vasileios Vlagkoulis, and Mihalis Psarakis
Veröffentlicht in: 2021
Herausgeber: IEEE International Symposium on Defect and Fault Tolerance in VLSI and Nanotechnology Systems (DFT)
DOI: 10.1109/dft52944.2021.9568280

Security and Reliability Evaluation of Countermeasures implemented using High-Level Synthesis.

Autoren: Koufopoulou, Amalia-Artemis, Kalliopi Xevgeni, Athanasios Papadimitriou, Mihalis Psarakis, and David Hely
Veröffentlicht in: 2022
Herausgeber: IEEE 28th International Symposium on On-Line Testing and Robust System Design (IOLTS)
DOI: 10.1109/iolts56730.2022.9897824